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最近期末了,要做设计,做为一个

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最近期末了,要做设计,做为一个学渣想求4位串并转换和4位并串转换的VHDL程序,求助~~!


来自Android客户端1楼2017-06-03 13:56回复
    为什么不是verilog


    来自Android客户端3楼2017-06-03 18:21
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