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高速PCB设计的信号完整性-华强pcb

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  高速PCB设计的信号完整性-华强pcb
  信号完整性基本上是阻抗匹配的问题。而影响阻抗匹配的因素有信号源的架构和输出阻抗(output impedance),走线的特性阻抗,负载端的特性,走线的拓朴(topology)架构等。解决的方式是靠端接(termination)与调整走线的拓朴。


1楼2018-03-09 10:28回复